The design and performance of a conflict-avoiding cache
Visualitza/Obre
Cita com:
hdl:2117/101279
Tipus de documentText en actes de congrés
Data publicació1997
EditorInstitute of Electrical and Electronics Engineers (IEEE)
Condicions d'accésAccés obert
Tots els drets reservats. Aquesta obra està protegida pels drets de propietat intel·lectual i
industrial corresponents. Sense perjudici de les exempcions legals existents, queda prohibida la seva
reproducció, distribució, comunicació pública o transformació sense l'autorització del titular dels drets
Abstract
High performance architectures depend heavily on efficient multi-level memory hierarchies to minimize the cost of accessing data. This dependence will increase with the expected increases in relative distance to main memory. There have been a number of published proposals for cache conflict-avoidance schemes. We investigate the design and performance of conflict-avoiding cache architectures based on polynomial modulus functions, which earlier research has shown to be highly effective at reducing conflict miss ratios. We examine a number of practical implementation issues and present experimental evidence to support the claim that pseudo-randomly indexed caches are both effective in performance terms and practical from an implementation viewpoint.
CitacióTopham, N., González, A., González, J. The design and performance of a conflict-avoiding cache. A: Annual IEEE/ACM International Symposium on Microarchitecture. "MICRO 30: proceedings of the 30th Annual ACM/IEEE International Symposium on Microarchitecture". San Francisco: Institute of Electrical and Electronics Engineers (IEEE), 1997, p. 71-80.
ISBN0-8186-7977-8
Versió de l'editorhttp://ieeexplore.ieee.org/document/645799/
Fitxers | Descripció | Mida | Format | Visualitza |
---|---|---|---|---|
00645799.pdf | 990,8Kb | Visualitza/Obre |