A new probabilistic design methodology of nanoscale digital circuits
Visualitza/Obre
05749358.pdf (637,8Kb) (Accés restringit)
Sol·licita una còpia a l'autor
Què és aquest botó?
Aquest botó permet demanar una còpia d'un document restringit a l'autor. Es mostra quan:
- Disposem del correu electrònic de l'autor
- El document té una mida inferior a 20 Mb
- Es tracta d'un document d'accés restringit per decisió de l'autor o d'un document d'accés restringit per política de l'editorial
10.1109/CONIELECOMP.2011.5749358
Inclou dades d'ús des de 2022
Cita com:
hdl:2117/13684
Tipus de documentText en actes de congrés
Data publicació2011
EditorIEEE Press. Institute of Electrical and Electronics Engineers
Condicions d'accésAccés restringit per política de l'editorial
Tots els drets reservats. Aquesta obra està protegida pels drets de propietat intel·lectual i
industrial corresponents. Sense perjudici de les exempcions legals existents, queda prohibida la seva
reproducció, distribució, comunicació pública o transformació sense l'autorització del titular dels drets
Abstract
The continuing trends of device scaling and increase in complexity towards terascale system on chip level of integration are putting growing difficulties into several areas of design.
The intrinsic variability problem is aggravated by variations caused by the difficulties of controlling Critical Dimension (CD) in nanometer technologies. The effect of variability is the difficulty in predicting and designing circuits with precise device and circuit characteristics. In this paper, a new logic design probabilistic methodology oriented to emerging and beyond CMOS in new technologies is presented, to improve tolerance to errors due to noise, defects or manufacturability errors in single gates, logic blocks or functional units. The methodology is based on the coherence of the input redundant ports using Port Redundancy (PR) and complementary redundant ports. Simulations show an excellent performance of our approach in the presence of large random noise at the inputs.
CitacióGarcía, L. [et al.]. A new probabilistic design methodology of nanoscale digital circuits. A: International Conference on Electrical Communications and Computers. "21st. International Conference on Electrical Communications and Computers". San Andres Cholula, Puebla: IEEE Press. Institute of Electrical and Electronics Engineers, 2011, p. 190-193.
Fitxers | Descripció | Mida | Format | Visualitza |
---|---|---|---|---|
05749358.pdf | 637,8Kb | Accés restringit |