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Títol: Desfasador sintonizable CMOS para aplicaciones de sintonía automática
Autor: Martínez García, Herminio
Vidal López, Eva María
Alarcón Cot, Eduardo José
Poveda López, Alberto
Altres autors/autores: Universitat Politècnica de Catalunya. Departament d'Enginyeria Electrònica; Universitat Politècnica de Catalunya. EPIC - Disseny de circuits analògics integrats i de convertidors de potencia conmutats
Editorial: Comité Organitzador SAAEI
Matèries: Àrees temàtiques de la UPC::Enginyeria electrònica i telecomunicacions
Electronic engineering
Enginyeria electrònica
Tipus de document: Conference report
Descripció: En este artículo se presenta el diseño e implementación de un desfasador con capacidad de sintonía mediante una tensión de control externa, que ofrece un desfase de π/2 a una frecuencia específica de interés. La utilización de resistencias negativas, y su fácil implementación mediante el bloque circuital conocido como MRC (MOS Resistive Circuit) simplifica notablemente el diseño y realización del mismo. Los resultados experimentales obtenidos y expuestos para una tecnología CMOS de 0,8 μm validan la funcionalidad del circuito.
Postprint (published version)
Altres identificadors i accés: Martinez, H. [et al.]. Desfasador sintonizable CMOS para aplicaciones de sintonía automática. A: Seminario Anual de Automática, Electrónica Industrial e Instrumentación. "VIII Seminario Anual de Automática, Electrónica Industrial e Instrumentación". Matanzas: Comité Organitzador SAAEI, 2001, p. 1-4.
84-699-5676-0
http://hdl.handle.net/2117/9412
Disponible al dipòsit:E-prints UPC
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